【FPGA】：ip核

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【FPGA】：ip核

2024-07-10 03:18:26| 来源: 网络整理| 查看: 265

文章目录一、概述二、端口说明[此章节为引用]三、 ip核的生成四、 matlab中cic滤波器的设计四、仿真五、参考资料

一、概述

在这里插入图片描述

二、端口说明[此章节为引用]

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三、 ip核的生成

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四、 matlab中cic滤波器的设计

在这里插入图片描述

此部分来源于博客在这里插入图片描述

总接: 在这里插入图片描述

四、仿真

第一组：采样率0.2MHZ，信号频率1Khz，抽取倍数5倍。在这里插入图片描述主程序：

`timescale 1ns / 1ps // // Company: // Engineer: // // Create Date: 2022/07/18 21:09:15 // Design Name: // Module Name: cic_ip_test // Project Name: // Target Devices: // Tool Versions: // Description: // // Dependencies: // // Revision: // Revision 0.01 - File Created // Additional Comments: // // module cic_ip_test(); reg aclk; reg [15:0] s_axis_data_tdata; reg s_axis_data_tvalid; wire s_axis_data_tready; wire [23:0] m_axis_data_tdata; wire m_axis_data_tvalid; parameter data_num=4000; //仿真数据长度 reg signed [9:0] stimulus[data_num-1:0]; integer i; /*********************时钟的产生***********************/ parameter period=10; initial aclk =0; always #(period/2) aclk=~aclk; /*********************信号的初始化***********************/ initial begin s_axis_data_tvalid

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