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一、课题要求
1.1 课题设计要求
课题设计的具体要求如下所示: 二、FPGA架构设计 2.1 FPGA顶层设计根据课题设计需求,设计FPGA的TOP层接口设计如下所示, 顶层接口包括: 1、系统时钟复位; 2、目的地选择,购票数目选择,取消操作控制; 3、纸币,硬币选项; 4、出票使能信号; 5、找余使能信号; 2.2 FPGA内部架构设计根据课题设计需求,FPGA内部的架构设计如下图所示, 架构内部主要包含: 1、money_count模块:主要功能是统计投入的总金额; 2、sub_control模块:主要功能是计算总的票价,计算找余金额,以及出票使能等控制信号; 3、zhaoling_unit模块:主要功能实现四种货币的找零功能; 4、chupiao模块:主要功能实现不同目的地以及具体的票数的处理任务,完成出票功能。 2.3 money_count模块投入金额计算功能代码如下: module money_count ( input i_sys_clk, input i_sys_rst_n, // input i_zhibi_in, //投纸币 input i_yingbi_in, //投硬币 input ci1,ci2,ci5,ci10, //1元?、2元?、5元、10元输入? input pi05,pi1, output [7:0] m_cout, //总钱数输出 input i_idle_en //体统完成一次购票操作之后恢复到起始状态使能; ); reg [2:0] q1,q2,q5,q10,q05; assign m_cout = q1 + 2*q2 + 5*q5 + 10*q10 + q05/2; //1元计数; always @ (posedge i_sys_clk or negedge i_sys_rst_n) begin if(~i_sys_rst_n) q05 |
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